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　　5月25日
，电气电子工程师学会（IEEE）在上海举办的国际电路与系统研讨会上，华为公司发表了韬（τ）定律 ，提出以“时间（τ）缩微 ”替代“几何缩微
”
，作为半导体与电子系统演进的新指导原则。通过逻辑折叠等创新技术，持续压缩信号传播时延 ，不断提升晶体管密度
，从而实现半导体与电子系统的持续演进
。

　　受上述消息影响，5月25日 ，A股半导体产业链表现强势。5月26日
，多只半导体产业链概念股逆势活跃，其中 ，中京电子、华天科技
、沃格光电等涨停 。

　　华为韬（τ）定律是什么？其核心技术是什么？目前是否有落地产品？对半导体产业有何意义与影响？跟着中证君一起来看看吧！

　　华为韬（τ）定律是什么？

　　“韬（τ）定律”是华为提出的半导体与电子系统演进的新指导原则
。其核心主张是以“时间（τ）缩微 ”替代“几何缩微
”，即不再单纯依赖将晶体管越做越小
，而是通过系统性降低时间常数τ，持续压缩芯片内部信号的传播时延 ，从而实现晶体管密度和系统性能的不断提升。

　　华为董事、半导体业务部总裁何庭波在论文中详细介绍了“韬（τ）定律” 。简单来说
，芯片竞赛不再看谁“做得小 ”，而是看谁让信号“跑得快”
。

　　这一转变在AI时代尤为迫切。AI算力集群的规模持续扩张 ，从单芯片 、数十芯片集群升级至数万芯片的超大规模集群 。然而
，现代AI系统的能耗与成本瓶颈，核心已不在算力计算 ，而在于数据传输
。数据显示
，大型AI集群超80%的能耗用于数据迁移，超70%的系统成本投入数据存储。这意味着 ，缩减芯片间
、机架内、封装内的数据传输耗时
，与降低计算耗时同等重要 。

　　韬（τ）定律的核心技术是什么？

　　实现“韬（τ）定律
”的核心技术是“逻辑折叠”（Logic Folding），并以此为基础构建了贯穿器件 、电路
、芯片到系统的四层级多层级协同优化体系
。

　　根据何庭波的论文 ，逻辑折叠即把原本平铺在芯片上的电路，像盖楼一样分层堆叠起来
，再用超密度的“垂直通道 ”连接。信号走的路径变短了，延迟就降下来了 。华为在手机芯片上已经实现了两层堆叠 ，未来会做到三到四层。

　　传统AI集群里
，数据在不同芯片、不同机架之间传输要经过多种协议转换，延迟高达几十微秒
。统一总线把这些“翻译
”环节全部去掉 ，让整个集群像一颗芯片一样协同工作
，延迟降到100纳秒左右。

　　韬（τ）定律不再把“光刻机能不能刻出更细的线”当作唯一瓶颈，而是通过垂直集成 、系统级协同
、光电混合来持续提升性能 。

　　韬（τ）定律目前有落地产品吗？

　　有 ，并且已经过大规模验证
。基于“韬（τ）定律 ”的技术路径
，华为在过去六年已成功设计并量产了381款芯片，覆盖智能手机、AI计算 、通信等多个领域。

　　何庭波的论文提到 ，华为2026年的手机SoC——麒麟2026
，已经采用了“逻辑折叠
”技术 。实测成果包括：

　　在不升级制造节点（即没有用更先进的光刻机）的情况下，晶体管密度从每平方毫米1.55亿个提升到2.38亿个 ，提升55%；能效（每瓦性能）提升41%；最高主频提升近13%，达到3.1GHz；SRAM（缓存）工作频率提升超过40%
。

　　此外
，论文还展示了AI系统层面的落地：统一总线和Hi-ONE光引擎已经在华为的AI集群（昇腾系列）中部署，远程访问延迟降低了约500倍 ，使得大规模集群更像一台单一计算机。

　　论文给出的时间表显示
，2026年麒麟2026已出硅片，2027年麒麟2027预计频率达3.39GHz ，2029年有望突破4GHz 。AI加速器方面
，昇腾950（2026年）
、昇腾990（约2030年）将逐步引入逻辑折叠和3D折叠
。

　　韬（τ）定律的提出，对半导体产业有何意义与影响？

　　“韬（τ）定律”的提出?/span>